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CD74AC164PWR

Name: Texas Instruments CD74AC164PWR
Brand: Texas Instruments
SKU: 595-CD74AC164PWR
Price: 0.89 USD
Availability: InStock

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Mouser N.º:

595-CD74AC164PWR

Fabricante N.º:

CD74AC164PWR

Fabricante:

Texas Instruments

Descripción:

Registros de cambio de contadores 8-Bit Serial-In/Para llel-Out Shift Regi

Ciclo de vida:

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	$0.636	$6.36
	$0.572	$14.30
	$0.501	$50.10
	$0.465	$116.25
	$0.446	$223.00
	$0.438	$438.00
Envase tipo carrete completo (pedir en múltiplos de 3000)
	$0.406	$1,218.00
	$0.395	$2,370.00

.hidden-for-nojs { display: none; } .pull-right-nojs { justify-content: flex-end; }

Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Registros de cambio de contadores
RoHS:
Tipo de contador:	Serial-In, Parallel-Out
Secuencia de recuento:	Serial to Parallel
Número de circuitos:	8 Circuit
Número de bits:	8 bit
Paquete / Cubierta:	TSSOP-14
Familia lógica:	AC
Tipo lógico:	Shift Register
Número de líneas de entrada:	4 Input
Tipo de salida:	Push-Pull
Tiempo de retardo de propagación:	6 ns
Voltaje de alimentación - Mín.:	1.5 V
Voltaje de alimentación - Máx.:	5.5 V
Temperatura de trabajo mínima:	- 55 C
Temperatura de trabajo máxima:	+ 125 C
Empaquetado:	Reel
Empaquetado:	Cut Tape
Marca:	Texas Instruments
País de ensamblaje:	Not Available
País de difusión:	Not Available
País de origen:	CN
Corriente de salida de nivel alto:	- 24 mA
Tipo de entrada:	CMOS
Corriente de salida de nivel bajo:	24 mA
Estilo de montaje:	SMD/SMT
Número de líneas de salida:	8 Output
Voltaje de alimentación operativo:	1.5 V to 5.5 V
Producto:	Shift Registers
Tipo de producto:	Counter Shift Registers
Tipo de restablecimiento:	Asynchronous
Serie:	CD74AC164
Cantidad de empaque de fábrica:	3000
Subcategoría:	Logic ICs
Tipo de disparador:	Rising Edge

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MXHTS:: 8542399999
CNHTS:: 8542399000
USHTS:: 8542390090
TARIC:: 8542319000
ECCN:: EAR99

CD74AC164/CD74ACT164 8-Bit SIPO Shift Registers

Texas Instruments CD74AC164/CD74ACT164 8-Bit SIPO Shift Registers have two serial inputs (A and B) connected through an AND gate and an asynchronous clear (CLR). The device requires a high signal on both A and B to set the input data line high; a low signal on either will set the input data line low. Data at A and B can be changed while CLK is high or low, provided the minimum set-up time requirements are met.